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FPGA高級工程師
面議 貴陽 應(yīng)屆畢業(yè)生 學(xué)歷不限
  • 全勤獎
  • 節(jié)日福利
  • 不加班
  • 周末雙休
貴州航天林泉電機有限公司 最近更新 2946人關(guān)注
職位描述
該職位還未進行加V認證,請仔細了解后再進行投遞!
1.負責采集測量、通信模塊、電氣、總線系統(tǒng)相關(guān)FPGA程序設(shè)計,包括通信總線、接口邏輯、通信算法實現(xiàn)、精密ADC高速DAC驅(qū)動、微代碼系統(tǒng)、可重構(gòu)在線升級功能等; 2.參與系統(tǒng)方案、軟硬件調(diào)試、系統(tǒng)聯(lián)調(diào),開展故障定位、問題解決和驗證; 3.編寫軟件相關(guān)文檔,參與用戶評審等。 任職資格:本科及以上學(xué)歷,通信、電子、計算機、自動化等相關(guān)專業(yè);5年以上FPGA相關(guān)工作經(jīng)驗,且獨立完成3項以上FPGA設(shè)計、編碼、仿真、測試硬件聯(lián)調(diào)等全流程工作;高效工作,能短時一次成功完成全流程開發(fā);熟練使用Verilog/VHDL硬件描述語言進行FPGA設(shè)計代碼及仿真Testbench編寫;熟悉XIllinx/Altera/Actel三大廠商多系列FPGA器件,熟練使用VIVODO、ISE、Quartus開發(fā)EDA;熟練使用FPGA仿真QUESTASIM/Modelsim和綜合synplify等工具;具備HDLC、UART、SPI、I2C等多總線協(xié)議,精密/高速模數(shù)ADC、數(shù)模DAC,EEPROM\Flash等存儲器使用和代碼設(shè)計工程經(jīng)驗;應(yīng)用MAtlab/Simulink實現(xiàn)通信、電氣系統(tǒng)設(shè)計、驗證并生成Verilog/VHDL代碼或IP模塊經(jīng)驗者優(yōu)先有ADI9361/9009等通信用微基站、直接變頻收發(fā)器IC經(jīng)驗者優(yōu)先;有FPGA高速接口如SRIO、LVDS、Ethernet相關(guān)經(jīng)驗者優(yōu)先;具備定位和處理復(fù)雜問題相關(guān)經(jīng)歷和能力,負責兩款以上產(chǎn)品開發(fā)、聯(lián)試、量產(chǎn)工作經(jīng)驗者優(yōu)先;具備較強學(xué)習(xí)能力,獨立開發(fā)項目能力,用戶、團隊合作意識、協(xié)調(diào)溝通能力。 職能類別:FPGA開發(fā)工程師 關(guān)鍵字:FPGA設(shè)計MAtlabSimulinkFPGA仿真VerilogVHDLQuartusVIVODOISE
聯(lián)系方式
注:聯(lián)系我時,請說是在四川人才網(wǎng)上看到的。
工作地點
地址:貴陽觀山湖區(qū)貴陽-觀山湖區(qū)
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詳細位置,可以參考上方地址信息
求職提示:用人單位發(fā)布虛假招聘信息,或以任何名義向求職者收取財物(如體檢費、置裝費、押金、服裝費、培訓(xùn)費、身份證、畢業(yè)證等),均涉嫌違法,請求職者務(wù)必提高警惕。
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