FPGA開(kāi)發(fā)工程師（初級(jí)）
面議
成都
應(yīng)屆畢業(yè)生
本科
成都
應(yīng)屆畢業(yè)生
本科
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
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職位描述
該職位信息待核驗(yàn)，請(qǐng)仔細(xì)了解后再進(jìn)行投遞！
一、工作職責(zé)：
1. 根據(jù)產(chǎn)品需求和計(jì)劃，負(fù)責(zé)邏輯開(kāi)發(fā)設(shè)計(jì)；
2.根據(jù)部門(mén)的相關(guān)制度及流程，負(fù)責(zé)邏輯聯(lián)試、測(cè)試及文檔編寫(xiě)等工作；
3.負(fù)責(zé)提供項(xiàng)目的邏輯技術(shù)支持；
4.上級(jí)交辦的其他工作。
二、任職資格要求：
1.學(xué)歷與專(zhuān)業(yè)：電子工程、通信工程、自動(dòng)化等相關(guān)專(zhuān)業(yè)，本科或以上學(xué)歷，英語(yǔ)四級(jí)以上，能夠熟練閱讀和理解英文資料；
2.工作經(jīng)驗(yàn)：1年以上工作經(jīng)驗(yàn)均可；
3.了解或熟悉verilog/VHDL語(yǔ)言，用過(guò)spi,uart,這類(lèi)基礎(chǔ)接口優(yōu)先
4.能在指導(dǎo)下完成基本功能的實(shí)現(xiàn)和調(diào)試
1. 根據(jù)產(chǎn)品需求和計(jì)劃，負(fù)責(zé)邏輯開(kāi)發(fā)設(shè)計(jì)；
2.根據(jù)部門(mén)的相關(guān)制度及流程，負(fù)責(zé)邏輯聯(lián)試、測(cè)試及文檔編寫(xiě)等工作；
3.負(fù)責(zé)提供項(xiàng)目的邏輯技術(shù)支持；
4.上級(jí)交辦的其他工作。
二、任職資格要求：
1.學(xué)歷與專(zhuān)業(yè)：電子工程、通信工程、自動(dòng)化等相關(guān)專(zhuān)業(yè)，本科或以上學(xué)歷，英語(yǔ)四級(jí)以上，能夠熟練閱讀和理解英文資料；
2.工作經(jīng)驗(yàn)：1年以上工作經(jīng)驗(yàn)均可；
3.了解或熟悉verilog/VHDL語(yǔ)言，用過(guò)spi,uart,這類(lèi)基礎(chǔ)接口優(yōu)先
4.能在指導(dǎo)下完成基本功能的實(shí)現(xiàn)和調(diào)試
注：聯(lián)系我時(shí)，請(qǐng)說(shuō)是在四川人才網(wǎng)上看到的。
工作地點(diǎn)
地址：成都青羊區(qū)騰飛大道189號(hào)15棟4層401
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職位發(fā)布者
HR
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